JZDP-D008-359-E

JZDP-D008-359-E作為一個(gè)候選的分割實(shí)現(xiàn)方式就是建立，其他非常有用的特性使其能夠被命名和保存。這允許用戶維持對(duì)多個(gè)可選擇的分割方案的控制。這種能力能夠與Certify軟件的影響分析特征一道使用，其允許用戶就在該多個(gè)FPGA開(kāi)發(fā)板上能夠得到的面積和I/O而論，估計(jì)布局和/或移動(dòng)邏輯。而不是用戶不得不推測(cè)這個(gè)邏輯應(yīng)該被分配給哪個(gè)FPGA，影響分析產(chǎn)生關(guān)于以那個(gè)分割決定為基礎(chǔ)的特定信息。

一旦分割已經(jīng)被執(zhí)行，Certify軟件用于綜合與不同的FPGA器件有關(guān)的代碼流。該工具使用同一個(gè)基本的綜合技術(shù)，就是起重要作用的Synplicity的主導(dǎo)市場(chǎng)的Synplify Pro? FPGA綜合引擎。例如，Certify軟件充分利用Synplicity的BEST? (Behavior Extracting Synthesis Technology?)算法，其分析RTL和在主要綜合步驟前實(shí)現(xiàn)高級(jí)優(yōu)化。并且，Certify工具以擁有Synplify Pro軟件的*的綜合能力為自豪，例如資源共享、寄存器平衡、重定時(shí)、復(fù)制以及再次綜合。

這個(gè)過(guò)程一個(gè)關(guān)鍵的方面是Certify軟件把不同的FPGA簡(jiǎn)單看作設(shè)計(jì)層次中一個(gè)額外的層。這意味著該工具提供針對(duì)性能優(yōu)化時(shí)序路徑的*能力，甚至當(dāng)這些路徑越過(guò)多個(gè)FPGA時(shí)(Certify軟件也能夠提供一個(gè)時(shí)序報(bào)告，其告知設(shè)計(jì)者原型在硬件被編程之前能夠達(dá)到的性能)。

：歐工
               
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