OA5102

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 從串配置模式

在串行模式下，需要微處理器或微控制器等外部主機(jī)通過同步串行接口將配置數(shù)據(jù)串行寫入FPGA芯片，其模式選擇信號(hào)M[2:0]=3’b111。典型的Spartan 3E系列FPGA單片配置電路如圖5.5.11所示。DIN輸入管腳的串行配置數(shù)據(jù)需要在外部時(shí)鐘CCLK 信號(hào)前有足夠的建立時(shí)間。其中單片F(xiàn)PGA 芯片構(gòu)成了完整的JTAG鏈，僅用來測試芯片狀態(tài)，以及支持JTAG 在線調(diào)試模式，與從串配置模式?jīng)]有關(guān)系。外部主機(jī)通過下拉PROG_B啟動(dòng)配置并檢測INIT_B 電平，當(dāng)INIT_B 為高時(shí)，表明FPGA 做好準(zhǔn)備，開始接收數(shù)據(jù)。此時(shí)，主機(jī)開始提供數(shù)據(jù)和時(shí)鐘信號(hào)直到FPGA 配置完畢且DONE 管腳為高，或者INIT_B 變低表明發(fā)生配置錯(cuò)誤才停止。整個(gè)過程需要比配置文件大小更多的時(shí)鐘周期，這是由于部分時(shí)鐘用于時(shí)序建立，特別當(dāng)FPGA 被配置為等待DCM鎖存其時(shí)鐘輸入。

圖5-32 FPGA從串配置電路示意圖

此外，從串配置模式也可配置多片F(xiàn)PGA芯片，典型的兩片Spartan 3E系列FPGA的從串配置電路如圖5-33所示。所有芯片的CCLK信號(hào)都有主控設(shè)備提供，靠近主控設(shè)備的FPGA要充當(dāng)橋梁的作用，將配置數(shù)據(jù)轉(zhuǎn)發(fā)到第二個(gè)FPGA芯片?？梢钥吹讲捎脧拇渲玫暮锰幹饕谟诠?jié)省電路板面積，并使得系統(tǒng)具備更大的靈活性。

：歐工
               
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